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崗位職責(zé)
1. 模擬IC設(shè)計(jì)ADC方向，包括：SAR ADC、Delta-Sigma ADC等設(shè)計(jì)；
2. 與系統(tǒng)工程師配合完成相關(guān)模塊規(guī)格定制，依據(jù)芯片的規(guī)格要求完成電路設(shè)計(jì)、仿真、驗(yàn)證等工作；
3. 負(fù)責(zé)電路關(guān)鍵部分Floor Plan，指導(dǎo)版圖工程師完成版圖設(shè)計(jì)；
4. 負(fù)責(zé)模塊測試、驗(yàn)證、Debug等工作；
5. 撰寫設(shè)計(jì)文檔等技術(shù)相關(guān)材料。

任職資格
1. 本科及以上微電子學(xué)/電子工程相關(guān)專業(yè)，8年以上模擬集成電路設(shè)計(jì)經(jīng)驗(yàn)；
2. 有扎實(shí)的模擬電路基礎(chǔ)知識，熟悉集成電路設(shè)計(jì)流程，了解版圖的層次、布局布線、版圖驗(yàn)證等相關(guān)知識；
3. 熟悉基本的模擬模塊，Bandgap，LDO，OPAMP，Comparator，PLL，有過ADC/DAC 設(shè)計(jì)經(jīng)驗(yàn)者優(yōu)先；
4. 熟悉先進(jìn)的半導(dǎo)體工藝和制程，有SoC成功設(shè)計(jì)流片經(jīng)驗(yàn)者優(yōu)先；
5. 熟練掌握模擬電路設(shè)計(jì)軟件，如Spectre、Hspice等EDA工具，能夠進(jìn)行電路原理圖設(shè)計(jì)、仿真和優(yōu)化；
6. 熟練掌握Verilog、VHDL等硬件描述語言；
7. 有良好的團(tuán)隊(duì)合作精神和溝通能力，工作踏實(shí)，并有強(qiáng)烈的責(zé)任心和學(xué)習(xí)熱情。